Ein-/Ausgabeanweisungen
5.5
Pulsweitenmodulation (DUTY)
CPU
QnA-Serie
Q4ARCPU
Operanden
MELSEC Q
Interne Operanden
(System, Anwender)
Bit
s1
—
s2
—
d1
—
d2
—
GX IEC
Developer
MELSEC-Anweisungsliste
GX
Developer
Variablen
Operand
s1
s2
d1
d2
Regelungsanweisungen MELSEC Q4AR/QnPH/QnPRH
System Q
Q12P(R)HCPU
Q25P(R)HCPU
©
MELSECNET/10/H
File-
Direkt J \
Register
Wort
Bit
©
©
—
©
©
—
©
©
—
©
©
—
Bedeutung
Anfangsadresse der Eingangsdaten
Dummy-Operand
(Als Dummy-Operand kann z. B. das Sonderregister SD1506 angegeben werden.)
Anfangsadresse des Blockspeichers
Anfangsadresse des Regelungskennsatzes
Pulsweitenmodulation (DUTY)
Operanden
Sonder-
Index-
module
Register
U \G
Zn
Wort
—
—
—
—
—
—
—
—
—
—
—
—
Kontaktplan
Error
Konstanten
Flag
Andere
K, H (16#)
—
—
—
—
SM0
—
—
—
—
IEC-Anweisungsliste
Schritte
8
U N I
R D M E
1 , U
N I R D
K E
1, UNIRDE1
UNIRDGE1
5 – 21